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IDT70V08S/L
High-Speed 3.3.V 64K x 8 Dual-Port Static RAM
Truth Table I – Chip Enable (1,2)
Industrial and Commercial Temperature Ranges
X
CE
L
H
CE 0
V IL
< 0.2V
V IH
X
>V CC -0.2V
(3)
CE 1
V IH
>V CC -0.2V
X
V IL
X (3)
<0.2V
Port Selected (TTL Active)
Port Selected (CMOS Active)
Port Deselected (TTL Inactive)
Port Deselected (TTL Inactive)
Port Deselected (CMOS Inactive)
Port Deselected (CMOS Inactive)
Mode
3740 tbl 06
NOTES:
1. Chip Enable references are shown above with the actual CE 0 and CE 1 levels; CE is a reference only.
2. 'H' = V IH and 'L' = V IL .
3. CMOS standby requires 'X' to be either < 0.2V or >V CC -0.2V.
Truth Table II – Non-Contention Read/Write Control
Inputs (1)
Outputs
CE
(2)
H
L
L
X
R/ W
X
L
H
X
OE
X
X
L
H
SEM
H
H
H
X
I/O 0-7
High-Z
DATA IN
DATA OUT
High-Z
Deselected: Power-Down
Write to Memory
Read Memory
Outputs Disabled
Mode
NOTES:
1. A 0L — A 15L ≠ A 0R — A 15R
2. Refer to Chip Enable Truth Table.
Truth Table III – Semaphore Read/Write Control (1)
3740 tbl 07
Inputs (1)
Outputs
CE
(2)
H
H
L
R/ W
H
↑
X
OE
L
X
X
SEM
L
L
L
I/O 0-7
DATA OUT
DATA IN
______
Read Semaphore Flag Data Out
Write I/O 0 into Semaphore Flag
Not Allowed
Mode
NOTES:
1. There are eight semaphore flags written to I/O 0 and read from all the I/Os (I/O 0 -I/O 7 ). These eight semaphore flags are addressed by A 0 -A 2 .
2. Refer to Chip Enable Truth Table.
4
3740 tbl 08
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